Amd एक इंटरपोज़र के साथ एपिक रोम मेमोरी समस्याओं को ठीक कर सकता है

एएमडी अपने ईपीवाईसी व्यापार प्रोसेसर के साथ डेटा सेंटर बाजार में प्रतिस्पर्धा में लौट आया, जो कि चार 8-कोर ज़ेपेलिन सरणियों के मॉड्यूल हैं। प्रत्येक ऐरे में अपना बिल्ट-इन नॉर्थ ब्रिज है, जो 2-चैनल DDR4 मेमोरी और 32-वे PCI-Express जनरल 3.0 रूट कॉम्प्लेक्स को नियंत्रित करता है । ऐसे अनुप्रयोगों में जिन्हें मेमोरी बैंडविड्थ के भारी उपयोग की आवश्यकता होती है, यह गैर-स्थानीयकृत मेमोरी दृष्टिकोण डिज़ाइन की अड़चनें प्रस्तुत करता है जिन्हें नए रोम में संबोधित किया जाएगा।

AMD EPYC रोम में एक अखंड मेमोरी डिज़ाइन होगा

प्रोसेसर के राइजन थ्रेडिपर WX परिवार इनमें से कई अड़चनों को हटाते हैं, वीडियो एन्कोडिंग अनुप्रयोगों के मामले में जिनमें बहुत अधिक मेमोरी की आवश्यकता होती है, प्रदर्शन बूंदों को प्रत्यक्ष I / O पहुंच में कमी चौड़ाई के बिना सरणियों के रूप में देखा जाता है। मेमोरी बैंड की। इस समस्या के लिए एएमडी का समाधान यह है कि सीपीयू को एक नॉर्थब्रिज विकलांग के साथ डिजाइन किया जाए। इस समाधान को इसके अगली पीढ़ी के ईपीवाईसी प्रोसेसर, जिसे " रोम " नाम दिया गया है , में लागू किया जा सकता है ।

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एएमडी की अगली पीढ़ी के एमसीएम एक केंद्रीयकृत प्रणाली नियंत्रक डिजाइन को मरते हुए देख सकते हैं, जो सभी एक सिलिकॉन इंटरपोजर में हो सकते हैं, वही प्रकार वेगा 10 और फिजी जीपीयू में पाए जाते हैं। एक इंटरपोज़र एक सिलिकॉन मैट्रिक्स है जो एमसीएम के मैट्रिक्स के बीच उच्च घनत्व वाले सूक्ष्म तारों की सुविधा देता है। वर्तमान पीढ़ी के EPYC प्रोसेसर के विपरीत, यह मेमोरी इंटरफ़ेस वास्तव में अखंड है, बहुत कुछ इंटेल के कार्यान्वयन की तरह।

सिस्टम कंट्रोलर में एक जटिल PCI-Express जीन 4.0 x96 रूट भी है, जो छह x 16 बैंडविड्थ ग्राफिक्स कार्ड या x8 पर बारह तक संभाल सकता है । मैट्रिक्स सर्वर के हब के रूप में जाने वाले साउथब्रिज को भी एकीकृत करता है, जो कुछ अन्य PCIe लाइनों के अलावा, सामान्य I / O इंटरफेस जैसे SATA, USB और अन्य लीगेसी कम-बैंडविड्थ I / O को लागू करता है।

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